enjoy-digital/litex

O que é?

Recursos principais

• 01Interconexões de barramentos e streams Wishbone, AXI e Avalon-ST.
• 02Cores prontos, incluindo RAM, ROM, timer, UART e JTAG.
• 03Suporte a várias soft CPUs, como VexRiscv, Rocket e PicoRV32.
• 04Integração de linguagens mistas com VHDL, Verilog e SystemVerilog.
• 05Simulação de SoCs com Verilator, sem placa FPGA.
• 06Backends de compilação para toolchains de FPGA open source e de fornecedores.

Casos de uso

• Montar um SoC personalizado em FPGA com uma soft CPU e periféricos.
• Reutilizar cores PCIe, Ethernet ou SATA existentes em um fluxo de trabalho HDL tradicional.
• Simular um SoC completo em um computador antes de executá-lo no hardware.
• Aprender design de FPGA usando um fluxo de trabalho baseado em Python.

Início rápido

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   Instale Python 3.7+ e as ferramentas do fabricante de FPGA e/ou o Verilator

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   Baixe o script litex_setup.py

   wget https://raw.githubusercontent.com/enjoy-digital/litex/master/litex_setup.py
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   Torne o script executável

   chmod +x litex_setup.py
4. 4

   Instale Migen, LiteX e o conjunto padrão de núcleos

   ./litex_setup.py --init --install --user --config=standard

Antes de usar

• !Para gerar bitstreams reais de FPGA, é necessário instalar separadamente as toolchains do fabricante ou o Verilator.
• !A lógica digital é descrita com Migen, que o próprio projeto aponta como a base atual.

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Perguntas frequentes

O que é litex?

Framework Python para criar cores e SoCs personalizados em FPGA, com barramentos, periféricos, integração de CPUs e suporte à simulação. LiteX é uma ferramenta Python para criar SoCs em FPGAs. Ela oferece os blocos de construção comuns necessários para montar um sistema completo em um FPGA: interconexões de barramentos e streams (Wishbone, AXI, Avalon-ST), cores simples como RAM, ROM, timers, UART e JTAG, além de bridges para depuração do SoC em execução pelo host.

litex é gratuito? Qual é a licença?

litex é open source sob a licença Other. Confira os termos da licença antes de usá-lo em produtos comerciais.

litex ainda é mantido?

Manutenção ativa. O último commit de litex foi em 6 de nov. de 2026.

Para que posso usar litex?

Montar um SoC personalizado em FPGA com uma soft CPU e periféricos. Reutilizar cores PCIe, Ethernet ou SATA existentes em um fluxo de trabalho HDL tradicional. Simular um SoC completo em um computador antes de executá-lo no hardware. Aprender design de FPGA usando um fluxo de trabalho baseado em Python.

Como instalar litex?

Instale Python 3.7+ e as ferramentas do fabricante de FPGA e/ou o Verilator Baixe o script litex_setup.py: wget https://raw.githubusercontent.com/enjoy-digital/litex/master/litex_setup.py Torne o script executável: chmod +x litex_setup.py Instale Migen, LiteX e o conjunto padrão de núcleos: ./litex_setup.py --init --install --user --config=standard

Onde consigo litex?

O código-fonte e as instruções de instalação estão no GitHub: https://github.com/enjoy-digital/litex